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NEC认可NC-Verilog仿真工具的签证(sign-off)能力 (2000.05.03)
Cadence发布新闻稿指出NEC的新一代特殊应用积体电路(ASIC)设计作业已能在NC-Verilog逻辑模拟技术中直接完成最后签证(Sign-off)的程序。透过一连串严谨的认证步骤，NEC将把NC-Verilog整合至其OpenCAD设计环境内，以支援超大型复杂晶片的开发工作


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