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Xilinx Vivado设计套件加入全新UltraFast设计方法
赛灵思全新设计方法可实现更快和可预期的设计周期

【CTIMES/SmartAuto 报导】   2013年10月25日 星期五

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美商赛灵思(Xilinx, Inc.)今日宣布针对其Vivado 设计套件推出全新UltraFast 设计方法。这套综合性的设计方法可协助设计团队运用Vivado 设计套件加速设计周期并提高其可预期性。赛灵思透过Vivado设计套件、用户指南、影片、讲师授课式培训课程、第三方设计工具与IP等,全力推动全新设计方法并协助用户快速上手并能广泛部署。

现今各种通讯、医疗、国防和消费性电子应用采用的高阶算法,让组件和设计工具的复杂度、效能与功耗不断突破极限,同时还要求不断加快和更能预测结果的设计周期。事实上,如同复杂的ASIC与SoC设计,类似的高阶设计项目的设计生产力和相关时程表也会有数周到数月的落差。为解决这些挑战的根本问题,赛灵思开发的UltraFast 设计方法可满足所有设计面向,如开发板规划、投入设计、IP 整合、建置与执行、编写程序和硬件除错等。

专为Vivado设计套件打造的UltraFast 设计方法

为协助设计人员能轻松采用UltraFast 设计方法,Vivado Design Suite 2013.3版本提供与此设计方法兼容的设计规则检查(DRC)功能,可在整个设计周期中提供工程师所需的指引。Vivado Design Suite 2013.3版本内含硬件描述语言(HDL)及规范样式,能带来最佳质量的设计结果。

为了能够有效加速设计周期并实现可预测的周期,赛灵思也与产业联盟计划成员合作,将UltraFast 设计方法的准则与成员公司生产的工具及IP进行整合。

Blue Pearl Software公司执行长Ellis Smith表示:「Blue Pearl Software套件与赛灵思Vivado设计套件的结合,能够为客户提供功能性的设计分析以验证UltraFast设计方法的标准、属性与设计规则。我们与赛灵思共同的客户都已见证了这套设计方法带来的自动化优势,不仅有助缩短编写精准RTL程序代码所需的时间, 而且还有助降低设计风险并提升设计结果的质量。」

關鍵字: UltraFast  Xilinx 
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