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Actel为Libero 6.3软件提供安全设计流程
 

【CTIMES/SmartAuto 劉筱萍报导】   2005年11月14日 星期一

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Actel公司宣布已为Libero整合设计环境(IDE)增加重要的崭新功能。全新的Libero 6.3软件可提供一种安全的设计流程—从合成到实施—以便将Actel的CoreMP7(业界第一款软ARM7系列处理器)整合到Actel的单芯片非挥发性现场可编程门阵列(FPGA)中。随着此一软件的推出,Actel在业界领先的SmartTime静态时序分析环境之基础上,进一步提供经强化的最小延迟支持,并以独特的方式实现高速FPGA的精确时间保持(hold-time)特性。这款经加强的软件还可自动实现I/O电压分配任务,并支持Actel的新型RTAX4000S器件,它是目前业界可支持太空应用的最高密度FPGA。

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Actel工具市场部高级经理Michael Mertz表示:“Libero 6.3 IDE结合业界最佳的第三方EDA工具和Actel的专有设计工具,延续了Actel以多功能工具套件提供无与伦比的价值的传统。透过提升Libero来支持软ARM7系列处理器的实施,我们可以让更多FPGA设计工程师享受到这种先进微处理器技术所带来的效益。而且,透过将先前的人工操作自动化,再提供独特的时序分析功能,使得FPGA设计工程师可以更快地获得最佳的成果。”

關鍵字: FPGA  Actel  Michael Mertz  可编程处理器 
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