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奈米級IC設計趨勢是EDA業者的新挑戰
專訪Cadence IC解決方案業務開發事業群副總裁黃小立

【作者: 鄭妤君】   2003年04月05日 星期六

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《照片人物 Cadence IC解決方案業務開發事業群副總裁黃小立》
《照片人物 Cadence IC解決方案業務開發事業群副總裁黃小立》

儘管全球半導體市場在近兩年來表現不佳,但EDA產業卻在不景氣當中逆勢成長,根據Dataquest的分析報告,全球EDA產業在2001~2006的年複合成長率為16.7%,市場規模也呈現穩定成長的態勢;在地區別市場方面,雖然目前仍以北美、歐洲與日本為排名前三大市場,但隨著半導體製造中心移往亞洲,以及台灣、大陸等地在IC設計產業上的蓬勃發展,亞太區市場未來的發展性對EDA業者來說不容忽視。根據工研院經資中心ITIS計畫的調查統計,亞太區EDA市場在2001~2006年的複合成長率可達20%,在全球EDA市場的佔有率更可在2006年突破10%,市場規模達5.68億美元。


此外,在IC設計逐漸朝向SoC發展、且晶片製程已經逐漸朝奈米等級的趨勢之下,IC設計業者面對日益細微而複雜的電路與功能,不但在設計過程中需克服更多困難與瓶頸,在競爭激烈的市場中所面臨的時間壓力與風險也越來越大,因此尋求更有效率、能提供更多事先驗證除錯功能的設計工具,已經成為IC設計業者的最新課題,也成為EDA業者必須迎接的挑戰。


向來在全球EDA市場中居領導地位的Cadence,自然沒有在奈米級IC設計的趨勢中缺席,該公司除了在日前發表一款適用奈米級設計的單一驗證核心平台“Incisive”,也積極與晶圓業者台積電(TSMC)合作,進行0.15、0.13微米以及90奈米以下的標準元件與IP資料庫交流,希望能協助客戶在奈米等級的IC設計流程中節省更多時間。
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