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使用 P4 與 Vivado工具簡化資料封包處理設計
 

【作者: AMD】   2024年05月27日 星期一

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加快設計週期有助於產品更早上市。實現多個設計選項的反覆運算更為簡便、快速。在創建 P4 之後可以獲取有關設計的延遲和系統記憶體需求的詳細資訊,有助於高層設計決策,例如裝置選擇。使用者也可以嘗試不同的選項。在做出初始決策之後,可以合成設計,並透過 Vivado工具的後端流程進行評估,以確定設計在資源配置和時序收斂方面的可行性。


AMD Vitis Networking P4 工具(VNP4)是一種高階設計環境,針對 FPGA 和自行調適 SoC 的封包處理資料平面,可實現簡化設計的效果。它能夠將用 P4 編寫的設計轉換為裝置就緒的 RTL 程式碼,以實現最佳的硬體實現。使用 VNP4,可以顯著減少開發基於裝置的資料封包處理系統所需的工程工作量,同時仍能實現每 LUT 或每 RAM 的高效能。


VNP4 的優勢大致可分為兩類,減少工程工作量和取得高品質、高效能結果。
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